MT18JSF51272PKIZ-1G4K1 Datasheet MT18JSF51272PKIZ-1G4D1, MT18JSF51272PKIZ-1G4K1, MT18JSF51272PKZ-1G4K1 | P7-P9

Table 6: Component-to-Module DQ Map, Front (Continued)

Component

Reference

Number

Component

DQ Module DQ

Module Pin

Number

Component

Reference

Number

Component

DQ Module DQ

Module Pin

Number

U11 0 58 116

1 61 232

2 63 238

3 56 110

4 62 237

5 60 231

6 59 117

7 57 111

Table 7: Component-to-Module DQ Map, Back

Component

Reference

Number

Component

DQ Module DQ

Module Pin

Number

Component

Reference

Number

Component

DQ Module DQ

Module Pin

Number

U12 0 53 223 U13 0 45 214

1 50 107 1 42 98

2 48 101 2 40 92

3 55 229 3 47 220

4 49 102 4 41 93

5 51 108 5 43 99

6 52 222 6 44 213

7 54 228 7 46 219

U14 0 37 205 U15 0 CB5 162

1 34 89 1 CB2 46

2 32 83 2 CB0 40

3 39 211 3 CB7 168

4 33 84 4 CB1 41

5 35 90 5 CB3 47

6 36 204 6 CB4 161

7 38 210 7 CB6 167

4GB (x72, ECC, DR) 244-Pin DDR3 SDRAM Mini-RDIMM

DQ Map

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Table 7: Component-to-Module DQ Map, Back (Continued)

Component

Reference

Number

Component

DQ Module DQ

Module Pin

Number

Component

Reference

Number

Component

DQ Module DQ

Module Pin

Number

U16 0 29 153 U17 0 21 144

1 26 37 1 18 28

2 24 31 2 16 22

3 31 159 3 23 150

4 25 32 4 17 23

5 27 38 5 19 29

6 28 152 6 20 143

7 30 158 7 22 149

U18 0 13 135 U19 0 61 232

1 10 19 1 58 116

2 8 13 2 56 110

3 15 141 3 63 238

4 9 14 4 57 111

5 11 20 5 59 117

6 12 134 6 60 231

7 14 140 7 62 237

U20 0 5 126

1 2 10

2 0 4

3 7 132

4 1 5

5 3 11

6 4 125

7 6 131

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DQ Map

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Functional Block Diagram

Figure 2: Functional Block Diagram

DQ

ZQ

DQ0

DQ1

DQ2

DQ3

DQ4

DQ5

DQ6

DQ7

DM/ NF/ CS# DQS DQS#

TDQS TDQS#

U8

DQ

DM/ NF/ CS# DQS DQS#

TDQS TDQS#

U20

DQ32

DQ33

DQ34

DQ35

DQ36

DQ37

DQ38

DQ39

DM/ NF/ CS# DQS DQS#

TDQS TDQS#

U5

DQ

DM/ NF/ CS# DQS DQS#

TDQS TDQS#

U14

DQS0

DQS0#

DM0/TDQS9

NF/TDQS9#

DQS4

DQS4#

DM4/TDQS13

NF/TDQS13#

DQ8

DQ9

DQ10

DQ11

DQ12

DQ13

DQ14

DQ15

DM/ NF/ CS# DQS DQS#

TDQS TDQS#

U1

DQ

DM/ NF/ CS# DQS DQS#

TDQS TDQS#

U18

DQ40

DQ41

DQ42

DQ43

DQ44

DQ45

DQ46

DQ47

DM/ NF/ CS# DQS DQS#

TDQS TDQS#

U6

DQ

DM/ NF/ CS# DQS DQS#

TDQS TDQS#

U13

DQS1

DQS1#

DM1/TDQS10

NF/TDQS10#

DQS5

DQS5#

DM5/TDQS14

NF/TDQS14#

DQ16

DQ17

DQ18

DQ19

DQ20

DQ21

DQ22

DQ23

DM/ NF/ CS# DQS DQS#

TDQS TDQS#

U2

DQ

DM/ NF/ CS# DQS DQS#

TDQS TDQS#

U17

DQ48

DQ49

DQ50

DQ51

DQ52

DQ53

DQ54

DQ55

DM/ NF/ CS# DQS DQS#

TDQS TDQS#

U7

DQ

DM/ NF/ CS# DQS DQS#

TDQS TDQS#

U12

DQS2

DQS2#

DM2/TDQS11

NF/TDQS11#

DQS6

DQS6#

DM6/TDQS15

NF/TDQS15#

DQ24

DQ25

DQ26

DQ27

DQ28

DQ29

DQ30

DQ31

DM/ NF/ CS# DQS DQS#

TDQS TDQS#

U3

DQ

DM/ NF/ CS# DQS DQS#

TDQS TDQS#

U16

DQ56

DQ57

DQ58

DQ59

DQ60

DQ61

DQ62

DQ63

DM/ NF/ CS# DQS DQS#

TDQS TDQS#

U11

DQ

DM/ NF/ CS# DQS DQS#

TDQS TDQS#

U19

DQS3

DQS3#

DM3/TDQS12

NF/TDQS12#

DQS7

DQS7#

DM7/TDQS16

NF/TDQS16#

CB0

CB1

CB2

CB3

CB4

CB5

CB6

CB7

DM/ NF/ CS# DQS DQS#

TDQS TDQS#

U4

DQ

DM/ NF/ CS# DQS DQS#

TDQS TDQS#

U15

DQS8

DQS8#

DM8/TDQS17

NF/TDQS17#

DQ

ZQ

DQ

ZQ

DQ

ZQ

DQ

ZQ

DQ

ZQ

DQ

ZQ

DQ

ZQ

DQ

ZQ

RS1#

RS0#

R

e

g

i

s

t

e

r

a

n

d

P

L

S0#

S1#

BA[2:0]

A[15:0]

RAS#

CAS#

WE#

CKE0

CKE1

ODT0

ODT1

Par_In

RESET#

CK0

CK0#

RS0#: Rank 0

RS1#: Rank 1

RBA[2:0]: DDR3 SDRAM

RA[14:0]: DDR3 SDRAM

RRAS#: DDR3 SDRAM

RCAS#: DDR3 SDRAM

RWE#: DDR3 SDRAM

RCKE0: Rank 0

RCKE1: Rank 1

RODT0: Rank 0

RODT1: Rank 1

Err_Out#

U9

V

REFCA

V

SS

DDR3 SDRAM

V

DD

Control, command,

and address termination

V

DDSPD

Temperature sensor

/SPD EEPROM

V

TT

DDR3 SDRAM

V

REFDQ

CK

CK#

DDR3 SDRAM

RS#[1:0], RCKE[1:0], RA[14:0],

RRAS#, RCAS#, RWE#,

RODT[1:0], RBA[2:0]

CK

CK#

ZQ

Rank 0: U1–U8, U11

Rank 1: U12–U20

Clock, control, command, and address line terminations:

DDR3

SDRAM

V

TT

DDR3

SDRAM

V

DD

U10

A0

Temperature

sensor/

SPD EEPROM

A1 A2

SA0 SA1

SDA

SCL

EVT

EVENT#

V

SS

SA2

V

SS

V

SS

V

SS

V

SS

V

SS

V

SS

V

SS

V

SS

V

SS

V

SS

V

SS

V

SS

V

SS

V

SS

V

SS

V

SS

V

SS

Note:

1. The ZQ ball on each DDR3 component is connected to an external 240Ω ±1% resistor

that is tied to ground. It is used for the calibration of the component’s ODT and output

driver.

4GB (x72, ECC, DR) 244-Pin DDR3 SDRAM Mini-RDIMM

Functional Block Diagram

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