MT36JSZF51272PZ-1G4G1 Datasheet MT36JSZF1G72PZ-1G1D1, MT36JSZF51272PZ-1G4G1, MT36JSZF1G72PZ-1G4D1 | P7-P9

Table 7: Component-to-Module DQ Map, Front (Continued)

Component

Reference

Number

Component

DQ Module DQ

Module Pin

Number

Component

Reference

Number

Component

DQ Module DQ

Module Pin

Number

U19 0 53 219 U20 0 61 228

1 54 224 1 62 233

2 52 218 2 60 227

3 55 225 3 63 234

Table 8: Component-to-Module DQ Map, Back

Component

Reference

Number

Component

DQ Module DQ

Module Pin

Number

Component

Reference

Number

Component

DQ Module DQ

Module Pin

Number

U21 0 56 108 U22 0 48 99

1 58 114 1 50 105

2 57 109 2 49 100

3 59 115 3 51 106

U23 0 40 90 U24 0 32 81

1 42 96 1 34 87

2 41 91 2 33 82

3 43 97 3 35 88

U25 0 CB0 39 U26 0 24 30

1 CB2 45 1 26 36

2 CB1 40 2 25 31

3 CB3 46 3 27 37

U27 0 16 21 U28 0 8 12

1 18 27 1 9 18

2 17 22 2 10 13

3 19 28 3 11 19

U29 0 0 3 U30 0 62 233

1 2 9 1 61 228

2 1 4 2 63 234

3 3 10 3 60 227

U31 0 54 224 U32 0 46 215

1 53 219 1 45 210

2 55 225 2 47 216

3 52 218 3 44 209

4GB, 8GB (x72, ECC, DR) 240-Pin DDR3 SDRAM RDIMM

DQ Map

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Table 8: Component-to-Module DQ Map, Back (Continued)

Component

Reference

Number

Component

DQ Module DQ

Module Pin

Number

Component

Reference

Number

Component

DQ Module DQ

Module Pin

Number

U33 0 38 206 U34 0 CB6 164

1 37 201 1 CB5 159

2 39 207 2 CB7 165

3 36 200 3 CB4 158

U35 0 30 155 U36 0 22 146

1 29 150 1 21 141

2 31 156 2 23 147

3 28 149 3 20 140

U37 0 14 137 U38 0 6 128

1 13 132 1 5 123

2 15 138 2 7 129

3 12 131 3 4 122

4GB, 8GB (x72, ECC, DR) 240-Pin DDR3 SDRAM RDIMM

DQ Map

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Functional Block Diagram

Figure 2: Functional Block Diagram

DM CS# DQS DQS#

DQ

ZQ

DQ0

DQ1

DQ2

DQ3

V

SS

DQ

U1

U29

DM CS# DQS DQS#

DQ

ZQ

DQ4

DQ5

DQ6

DQ7

V

SS

DQ

U12

U38

DM CS# DQS DQS#

DQS0

DQS0#

DM CS# DQS DQS#

DQ

ZQ

DQ8

DQ9

DQ10

DQ11

V

SS

DQ

U2

U28

DM CS# DQS DQS#

DQ

ZQ

DQ12

DQ13

DQ14

DQ15

V

SS

DQ

U13

U37

DM CS# DQS DQS#

DQ

ZQ

DQ16

DQ17

DQ18

DQ19

V

SS

DQ

U3

U27

DM CS# DQS DQS#

DQ

ZQ

DQ20

DQ21

DQ22

DQ23

V

SS

DQ

U14

U36

DM CS# DQS DQS#

DQ

ZQ

DQ24

DQ25

DQ26

DQ27

V

SS

DQ

U4

U26

DM CS# DQS DQS#

DQ

ZQ

DQ28

DQ29

DQ30

DQ31

V

SS

DQ

U15

U35

DM CS# DQS DQS#

DQ

ZQ

CB0

CB1

CB2

CB3

V

SS

DQ

U5

U25

DM CS# DQS DQS#

DQ

ZQ

CB4

CB5

CB6

CB7

V

SS

DQ

U16

U34

DM CS# DQS DQS#

DQ

ZQ

DQ32

DQ33

DQ34

DQ35

V

SS

DQ

U8

U24

DM CS# DQS DQS#

DQ

ZQ

DQ36

DQ37

DQ38

DQ39

V

SS

DQ

U17

U33

DM CS# DQS DQS#

DQS4

DQS4#

DM CS# DQS DQS#

DQ

ZQ

DQ40

DQ41

DQ42

DQ43

V

SS

DQ

U9

U23

DM CS# DQS DQS#

DQ

ZQ

DQ44

DQ45

DQ46

DQ47

V

SS

DQ

U18

U32

DM CS# DQS DQS#

DQ

ZQ

DQ48

DQ49

DQ50

DQ51

V

SS

DQ

U10

U22

DM CS# DQS DQS#

DQ

ZQ

DQ52

DQ53

DQ54

DQ55

V

SS

DQ

U19

U31

DM CS# DQS DQS#

DQ

ZQ

DQ56

DQ57

DQ58

DQ59

V

SS

DQ

U11

U21

DM CS# DQS DQS#

DQ

ZQ

DQ60

DQ61

DQ62

DQ63

V

SS

DQ

U20

U30

DM CS# DQS DQS#

RS0#

RS1#

ZQ

V

SS

ZQ

R

e

g

i

s

t

e

r

a

n

d

P

L

S0#

S1#

BA[2:0]

A[15:0]

RAS#

CAS#

WE#

CKE0

CKE1

ODT0

ODT1

Par_In

RESET#

CK0

CK0#

RS0#: Rank 0

RS1#: Rank 1

RBA[2:0]: DDR3 SDRAM

RA[14/13:0]: DDR3 SDRAM

RRAS#: DDR3 SDRAM

RCAS#: DDR3 SDRAM

RWE#: DDR3 SDRAM

RCKE0: Rank 0

RCKE1: Rank 1

RODT0: Rank 0

RODT1: Rank 1

Err_Out#

U7

V

REFCA

V

SS

DDR3 SDRAM

V

DD

DDR3 SDRAM

V

DDSPD

Temperature sensor/

SPD EEPROM

V

TT

DDR3 SDRAM

V

REFDQ

CK

CK#

DDR3 SDRAM

Clock, control, command, and address line terminations:

Rank 0: U1–U5, U8–U20

Rank 1: U21–U38

V

SS

V

SS

V

SS

V

SS

V

SS

V

SS

V

SS

V

SS

V

SS

V

SS

V

SS

V

SS

V

SS

V

SS

V

SS

V

SS

V

SS

V

SS

RS#[1:0], RBA[2:0], RA[14/13:0],

RRAS#, RCAS, RWE#,

RCKE[1:0], RODT[1:0]

DDR3

SDRAM

V

TT

CK

CK#

DDR3

SDRAM

V

DD

U6

A0

Temperature sensor/

SPD EEPROM

A1 A2

SA0 SA1

SDA

SCL

EVT

EVENT#

SA2

DQS1

DQS1#

DQS2

DQS2#

DQS3

DQS3#

DQS8

DQS8#

DQS5

DQS5#

DQS6

DQS6#

DQS7

DQS7#

DQS9

DQS9#

DQS10

DQS10#

DQS11

DQS11#

DQS12

DQS12#

DQS17

DQS17#

DQS13

DQS13#

DQS14

DQS14#

DQS15

DQS15#

DQS16

DQS16#

Note:

1.

The ZQ ball on each DDR3 component is connected to an external 240Ω ±1% resistor

that is tied to ground. It is used for the calibration of the component’s ODT and output

driver.

4GB, 8GB (x72, ECC, DR) 240-Pin DDR3 SDRAM RDIMM

Functional Block Diagram

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