MT36KSS2G72RHZ-1G6E1 Datasheet MT36KSS2G72RHZ-1G6E1 | P7-P9

Table 6: Component-to-Module DQ Map, Front (Continued)

Component

Reference

Number

Component

DQ Module DQ

Module Pin

Number

Component

Reference

Number

Component

DQ Module DQ

Module Pin

Number

U11 0 57 185

1 62 192

2 61 182

3 63 194

4 60 180

5 59 193

6 56 183

7 58 191

Table 7: Component-to-Module DQ Map, Back

Component

Reference

Number

Component

DQ Module DQ

Module Pin

Number

Component

Reference

Number

Component

DQ Module DQ

Module Pin

Number

U12 0 53 168 U13 0 37 136

1 54 174 1 38 142

2 49 167 2 33 135

3 50 177 3 39 144

4 52 166 4 36 134

5 51 179 5 35 147

6 48 165 6 32 133

7 55 176 7 34 145

U14 0 21 42 U15 0 1 7

1 22 48 1 2 13

2 20 40 2 0 5

3 23 50 3 3 15

4 17 39 4 5 6

5 19 51 5 7 18

6 16 37 6 4 4

7 18 49 7 6 16

16GB (x8, ECC, QR) 204-Pin 1.35V DDR3L SORDIMM

DQ Map

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7

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Table 7: Component-to-Module DQ Map, Back (Continued)

Component

Reference

Number

Component

DQ Module DQ

Module Pin

Number

Component

Reference

Number

Component

DQ Module DQ

Module Pin

Number

U16 0 62 192 U17 0 46 160

1 57 185 1 41 153

2 63 194 2 47 162

3 61 182 3 45 150

4 58 191 4 42 159

5 56 183 5 40 151

6 59 193 6 43 161

7 60 180 7 44 148

U18 0 CB6 80 U19 0 27 65

1 CB1 71 1 25 57

2 CB2 81 2 31 68

3 CB5 74 3 29 56

4 CB7 82 4 26 63

5 CB4 72 5 24 55

6 CB3 83 6 30 66

7 CB0 69 7 28 54

U20 0 11 33

1 13 24

2 15 36

3 12 22

4 10 31

5 9 21

6 14 34

7 8 19

16GB (x8, ECC, QR) 204-Pin 1.35V DDR3L SORDIMM

DQ Map

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8

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Functional Block Diagram

Figure 2: Functional Block Diagram

DQ

DM/ NF/ CS# DQS DQS#

TDQS TDQS#

U1t

DQ

DM/ NF/ CS# DQS DQS#

TDQS TDQS#

U1b

ZQ

V

SS

ZQ

V

SS

V

SS

V

SS

V

SS

V

SS

V

SS

V

SS

V

SS

V

SS

V

SS

V

SS

V

SS

V

SS

V

SS

V

SS

V

SS

V

SS

V

SS

V

SS

V

SS

V

SS

V

SS

V

SS

V

SS

V

SS

V

SS

V

SS

V

SS

V

SS

V

SS

V

SS

V

SS

V

SS

V

SS

V

SS

DQ

DM/ NF/ CS# DQS DQS#

TDQS TDQS#

U15t

DQ

DM/ NF/ CS# DQS DQS#

TDQS TDQS#

U15b

ZQ

DQ

DM/ NF/ CS# DQS DQS#

TDQS TDQS#

U5t

DQ

DM/ NF/ CS# DQS DQS#

TDQS TDQS#

U5b

ZQ

DQ

DM/ NF/ CS# DQS DQS#

TDQS TDQS#

U13t

DQ

DM/ NF/ CS# DQS DQS#

TDQS TDQS#

U13b

ZQ

RS0#

RS1#

RS2#

RS3#

DQ

DM/ NF/ CS# DQS DQS#

TDQS TDQS#

U7t

DQ

DM/ NF/ CS# DQS DQS#

TDQS TDQS#

U7b

ZQ

DQ

DM/ NF/ CS# DQS DQS#

TDQS TDQS#

U20t

DQ

DM/ NF/ CS# DQS DQS#

TDQS TDQS#

U20b

ZQ

DQ

DM/ NF/ CS# DQS DQS#

TDQS TDQS#

U10t

DQ

DM/ NF/ CS# DQS DQS#

TDQS TDQS#

U10b

ZQ

DQ

DM/ NF/ CS# DQS DQS#

TDQS TDQS#

U17t

DQ

DM/ NF/ CS# DQS DQS#

TDQS TDQS#

U17b

ZQ

DQ

DM/ NF/ CS# DQS DQS#

TDQS TDQS#

U2t

DQ

DM/ NF/ CS# DQS DQS#

TDQS TDQS#

U2b

ZQ

DQ

DM/ NF/ CS# DQS DQS#

TDQS TDQS#

U14t

DQ

DM/ NF/ CS# DQS DQS#

TDQS TDQS#

U14b

ZQ

DQ

DM/ NF/ CS# DQS DQS#

TDQS TDQS#

U6t

DQ

DM/ NF/ CS# DQS DQS#

TDQS TDQS#

U6b

ZQ

DQ

DM/ NF/ CS# DQS DQS#

TDQS TDQS#

U12t

DQ

DM/ NF/ CS# DQS DQS#

TDQS TDQS#

U12b

ZQ

DQ

DM/ NF/ CS# DQS DQS#

TDQS TDQS#

U8t

DQ

DM/ NF/ CS# DQS DQS#

TDQS TDQS#

U8b

ZQ

DQ

DM/ NF/ CS# DQS DQS#

TDQS TDQS#

U19t

DQ

DM/ NF/ CS# DQS DQS#

TDQS TDQS#

U17b

ZQ

DQ

DM/ NF/ CS# DQS DQS#

TDQS TDQS#

U11t

DQ

DM/ NF/ CS# DQS DQS#

TDQS TDQS#

U11b

ZQ

DQ

DM/ NF/ CS# DQS DQS#

TDQS TDQS#

U16t

DQ

DM/ NF/ CS# DQS DQS#

TDQS TDQS#

U16b

ZQ

DQ

DM/ NF/ CS# DQS DQS#

TDQS TDQS#

U9t

DQ

DM/ NF/ CS# DQS DQS#

TDQS TDQS#

U9b

ZQ

DQ

DM/ NF/ CS# DQS DQS#

TDQS TDQS#

U18t

DQ

DM/ NF/ CS# DQS DQS#

TDQS TDQS#

U18b

ZQ

R

e

g

i

s

t

e

r

a

n

d

P

L

S0#

S1#

S2#

S3#

BA[2:0]

A[15:0]

RAS#

CAS#

WE#

CKE0

CKE1

ODT

ODT1

Par_In

RESET#

CK0

CK0#

RS0#: Rank 0

RS1#: Rank 1

RS2#: Rank 2

RS3#: Rank 3

RBA[2:0]: DDR3 SDRAM

RA[15:0]: DDR3 SDRAM

RRAS#: DDR3 SDRAM

RCAS#: DDR3 SDRAM

RWE#: DDR3 SDRAM

RCKE0: Rank 0, Rank 2

RCKE1: Rank 1, Rank 3

RODT0: Rank 0, Rank 1 ODT tied to V

DD

RODT1: Rank 2, Rank 3 ODT tied to V

DD

Err_Out#

U4

V

REFCA

V

SS

DDR3 SDRAM

V

DD

Control, commad and

address termination

V

DDSPD

SPD EEPROM/

Temperature sensor

V

TT

DDR3 SDRAM

V

REFDQ

CK

CK#

DDR3 SDRAM

Rank 0: U1t, U2t, U5t–U11t

Rank 1: U1b, U2b, U5b–U11b

Rank 2: U12t–U20t

Rank 3: U12b–U20b

RS#[3:0], RCKE[1:0], RA[15:0],

RRAS#, RCAS#, RWE#,

RODT[1:0], RBA[2:0]

CK

CK#

Command, control, address, and clock line terminations:

DDR3

SDRAM

DDR3

SDRAM

V

TT

V

DD

U3

A0

SPD EEPROM/

Temperature

sensor

A1 A2

SA0 SA1

SDA

SCL

EVT

EVENT#

V

SS

DQS0

DQS0#

DM0/DQS9

NF/DQS9#

DQ0

DQ1

DQ2

DQ3

DQ4

DQ5

DQ6

DQ7

DQS1

DQS1#

DM1/DQS10

NF/DQS10#

DQ8

DQ9

DQ10

DQ11

DQ12

DQ13

DQ14

DQ15

DQS2

DQS2#

DM2/DQS11

NF/DQS11#

DQ16

DQ17

DQ18

DQ19

DQ20

DQ21

DQ22

DQ23

DQS3

DQS3#

DM3/DQS12

NF/DQS12#

DQ24

DQ25

DQ26

DQ27

DQ28

DQ29

DQ30

DQ31

DQS8

DQS8#

DM8/DQS17

NF/DQS17#

CB0

CB1

CB2

CB3

CB4

CB5

CB6

CB7

DQS4

DQS4#

DM4/DQS13

NF/DQS13#

DQ32

DQ33

DQ34

DQ35

DQ36

DQ37

DQ38

DQ39

DQS5

DQS5#

DM5/DQS14

NF/DQS14#

DQ40

DQ41

DQ42

DQ43

DQ44

DQ45

DQ46

DQ47

DQS6

DQS6#

DM6/DQS15

NF/DQS15#

DQ48

DQ49

DQ50

DQ51

DQ52

DQ53

DQ54

DQ55

DQS7

DQS7#

DM7/DQS16

NF/DQS16#

DQ56

DQ57

DQ58

DQ59

DQ60

DQ61

DQ62

DQ63

Note:

1. The ZQ ball on each DDR3 component is connected to an external 240Ω ±1% resistor

that is tied to ground. It is used for the calibration of the component’s ODT and output

driver.

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Functional Block Diagram

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