MT18KDF1G72PDZ-1G6P1 Datasheet MT18KDF1G72PDZ-1G6P1, MT18KDF51272PDZ-1G6K1, MT18KDF1G72PDZ-1G4E1 | P7-P9

Table 7: Component-to-Module DQ Map, Front (Continued)

Component

Reference

Number

Component

DQ Module DQ

Module Pin

Number

Component

Reference

Number

Component

DQ Module DQ

Module Pin

Number

U10 0 58 114

1 57 109

2 59 115

3 56 108

4 62 233

5 60 227

6 63 234

7 61 228

Table 8: Component-to-Module DQ Map, Back

Component

Reference

Number

Component

DQ Module DQ

Module Pin

Number

Component

Reference

Number

Component

DQ Module DQ

Module Pin

Number

U11 0 57 109 U12 0 49 100

1 58 114 1 50 105

2 56 108 2 48 99

3 69 115 3 51 106

4 61 228 4 53 219

5 63 234 5 55 225

6 60 227 6 52 218

7 62 233 7 54 224

U13 0 41 91 U14 0 33 82

1 42 96 1 34 87

2 40 90 2 32 81

3 43 97 3 35 88

4 45 210 4 37 201

5 47 216 5 39 207

6 44 209 6 36 200

7 46 215 7 38 206

4GB, 8GB (x72, ECC, DR) 240-Pin 1.35V DDR3L VLP RDIMM

DQ Map

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7

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Table 8: Component-to-Module DQ Map, Back (Continued)

Component

Reference

Number

Component

DQ Module DQ

Module Pin

Number

Component

Reference

Number

Component

DQ Module DQ

Module Pin

Number

U16 0 CB1 40 U17 0 25 31

1 CB2 45 1 26 36

2 CB0 39 2 24 30

3 CB3 46 3 27 37

4 CB5 159 4 29 150

5 CB7 165 5 31 156

6 CB4 158 6 28 149

7 CB6 164 7 30 155

U18 0 17 22 U19 0 9 13

1 18 27 1 10 18

2 16 21 2 8 12

3 19 28 3 11 19

4 21 141 4 13 132

5 23 147 5 15 138

6 20 140 6 12 131

7 22 146 7 14 137

U20 0 1 4

1 2 9

2 0 3

3 3 10

4 5 123

5 7 129

6 4 122

7 6 128

4GB, 8GB (x72, ECC, DR) 240-Pin 1.35V DDR3L VLP RDIMM

DQ Map

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Functional Block Diagram

Figure 3: Functional Block Diagram

DQ

ZQ

DQ0

DQ1

DQ2

DQ3

DQ4

DQ5

DQ6

DQ7

DM/ NU/ CS# DQS DQS#

RDQS RDQS#

U1

DQ

DM/ NU/ CS# DQS DQS#

RDQS RDQS#

U20

DQ32

DQ33

DQ34

DQ35

DQ36

DQ37

DQ38

DQ39

DM/ NU/ CS# DQS DQS#

RDQS RDQS#

U7

DQ

DM/ NU/ CS# DQS DQS#

RDQS RDQS#

U14

DQS0

DQS0#

DM0/DQS9

NF/TDQS9#

DQS4

DQS4#

DM4/DQS13

NF/TDQS13#

DQ8

DQ9

DQ10

DQ11

DQ12

DQ13

DQ14

DQ15

DM/ NU/ CS# DQS DQS#

RDQS RDQS#

U2

DQ

DM/ NU/ CS# DQS DQS#

RDQS RDQS#

U19

DQ40

DQ41

DQ42

DQ43

DQ44

DQ45

DQ46

DQ47

DM/ NU/ CS# DQS DQS#

RDQS RDQS#

U8

DQ

DM/ NU/ CS# DQS DQS#

RDQS RDQS#

U13

DQS1

DQS1#

DM1/DQS10

NF/TDQS10#

DQS5

DQS5#

DM5/DQS14

NF/TDQS14#

DQ16

DQ17

DQ18

DQ19

DQ20

DQ21

DQ22

DQ23

DM/ NU/ CS# DQS DQS#

RDQS RDQS#

U3

DQ

DM/ NU/ CS# DQS DQS#

RDQS RDQS#

U18

DQ48

DQ49

DQ50

DQ51

DQ52

DQ53

DQ54

DQ55

DM/ NU/ CS# DQS DQS#

RDQS RDQS#

U9

DQ

DM/ NU/ CS# DQS DQS#

RDQS RDQS#

U12

DQS2

DQS2#

DM2/DQS11

NF/TDQS11#

DQS6

DQS6#

DM6/DQS15

NF/TDQS15#

DQ24

DQ25

DQ26

DQ27

DQ28

DQ29

DQ30

DQ31

DM/ NU/ CS# DQS DQS#

RDQS RDQS#

U4

DQ

DM/ NU/ CS# DQS DQS#

RDQS RDQS#

U17

DQ56

DQ57

DQ58

DQ59

DQ60

DQ61

DQ62

DQ63

DM/ NU/ CS# DQS DQS#

RDQS RDQS#

U10

DQ

DM/ NU/ CS# DQS DQS#

RDQS RDQS#

U11

DQS3

DQS3#

DM3/DQS12

NF/TDQS12#

DQS7

DQS7#

DM7/DQS16

NF/TDQS16#

CB0

CB1

CB2

CB3

CB4

CB5

CB6

CB7

DM/ NU/ CS# DQS DQS#

RDQS RDQS#

U5

DQ

DM/ NU/ CS# DQS DQS#

RDQS RDQS#

U16

DQS8

DQS8#

DM8/DQS17

NF/TDQS17#

DQ

ZQ

DQ

ZQ

DQ

ZQ

DQ

ZQ

DQ

ZQ

DQ

ZQ

DQ

ZQ

DQ

ZQ

RS1#

RS0#

R

e

g

i

s

t

e

r

a

n

d

P

L

S0#

S1#

BA[2:0]

A[15:0]

RAS#

CAS#

WE#

CKE0

CKE1

ODT0

ODT1

RESET#

CK0

CK0#

RS0#: Rank 0

RS1#: Rank 1

RBA[2:0]: DDR3 SDRAM

RA[15/14:0]: DDR3 SDRAM

RRAS#: DDR3 SDRAM

RCAS#: DDR3 SDRAM

RWE#: DDR3 SDRAM

RCKE0: Rank 0

RCKE1: Rank 1

RODT0: Rank 0

RODT1: Rank 1

U6

V

REFCA

V

SS

DDR3 SDRAM

V

DD

Control, command, and

address termination

V

DDSPD

Temperature sensor/

SPD EEPROM

V

TT

DDR3 SDRAM

V

REFDQ

CK

CK#

DDR3 SDRAM

RS#[1:0], RCKE[1:0], RA[15/14:0],

RRAS#, RRCAS, RWE#,

RODT[1:0], RBA[2:0]

CK

CK#

ZQ

Rank 0: U1–U5, U7–U10

Rank 1: U11–14, U16–U20

Clock, control, command, and address line terminations:

DDR3

SDRAM

V

TT

DDR3

SDRAM

V

DD

U20A

A0

Temperature

sensor/

SPD EEPROM

A1 A2

SA0 SA1

SDA

SCL

EVT

EVENT#

SA2

V

SS

V

SS

V

SS

V

SS

V

SS

V

SS

V

SS

V

SS

V

SS

V

SS

V

SS

V

SS

V

SS

V

SS

V

SS

V

SS

V

SS

V

SS

Par_In Err_Out #

Note:

1. The ZQ ball on each DDR3 component is connected to an external 240Ω ±1% resistor

that is tied to ground. It is used for the calibration of the component’s ODT and output

driver.

4GB, 8GB (x72, ECC, DR) 240-Pin 1.35V DDR3L VLP RDIMM

Functional Block Diagram

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