MT18KSF1G72AZ-1G4D1 Datasheet MT18KSF1G72AZ-1G6P1, MT18KSF51272AZ-1G6K1, MT18KSF1G72AZ-1G4D1 | P7-P9

Table 7: Component-to-Module DQ Map (Continued)

Component

Reference

Number

Component

DQ Module DQ

Module Pin

Number

Component

Reference

Number

Component

DQ Module DQ

Module Pin

Number

U9 0 58 114 U11 0 61 228

1 61 228 1 58 114

2 63 234 2 56 108

3 56 108 3 63 234

4 62 233 4 57 109

5 60 227 5 59 115

6 59 115 6 60 227

7 57 109 7 62 233

U12 0 53 219 U13 0 45 210

1 50 105 1 42 96

2 48 99 2 40 90

3 55 225 3 47 216

4 49 100 4 41 91

5 51 106 5 43 97

6 52 218 6 44 209

7 54 224 7 46 215

U14 0 37 201 U15 0 CB5 159

1 34 87 1 CB2 45

2 32 81 2 CB0 39

3 39 207 3 CB7 165

4 33 82 4 CB1 40

5 35 88 5 CB3 46

6 36 200 6 CB4 158

7 38 206 7 CB6 164

U16 0 29 150 U17 0 21 141

1 26 36 1 18 27

2 24 30 2 16 21

3 31 156 3 23 147

4 25 31 4 17 22

5 27 37 5 19 28

6 28 149 6 20 140

7 30 155 7 22 146

4GB, 8GB (x72, ECC, DR) 240-Pin DDR3L UDIMM

DQ Map

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7

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Table 7: Component-to-Module DQ Map (Continued)

Component

Reference

Number

Component

DQ Module DQ

Module Pin

Number

Component

Reference

Number

Component

DQ Module DQ

Module Pin

Number

U18 0 13 132 U19 0 5 123

1 10 18 1 2 9

2 8 12 2 0 3

3 15 138 3 7 129

4 9 13 4 1 4

5 11 19 5 3 10

6 12 131 6 4 122

7 14 137 7 6 128

4GB, 8GB (x72, ECC, DR) 240-Pin DDR3L UDIMM

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Functional Block Diagram

Figure 3: Functional Block Diagram

DQ

ZQ

DQ0

DQ1

DQ2

DQ3

DQ4

DQ5

DQ6

DQ7

DM CS# DQS DQS#

U1

DQ

U19

DQ32

DQ33

DQ34

DQ35

DQ36

DQ37

DQ38

DQ39

U6

DQ

U14

DQS0

DQS0#

DM0

DQS4

DQS4#

DM4

DQ8

DQ9

DQ10

DQ11

DQ12

DQ13

DQ14

DQ15

U2

DQ

U18

DQ40

DQ41

DQ42

DQ43

DQ44

DQ45

DQ46

DQ47

U7

DQ

U13

DQS1

DQS1#

DM1

DQS5

DQS5#

DM5

DQ16

DQ17

DQ18

DQ19

DQ20

DQ21

DQ22

DQ23

U3

DQ

U17

DQ48

DQ49

DQ50

DQ51

DQ52

DQ53

DQ54

DQ55

U8

DQ

U12

DQS2

DQS2#

DM2

DQS6

DQS6#

DM6

DQ24

DQ25

DQ26

DQ27

DQ28

DQ29

DQ30

DQ31

U4

DQ

U16

DQ56

DQ57

DQ58

DQ59

DQ60

DQ61

DQ62

DQ63

U9

DQ

U11

DQS3

DQS3#

DM3

DQS7

DQS7#

DM7

CB0

CB1

CB2

CB3

CB4

CB5

CB6

CB7

U5

DQ

U15

DQS8

DQS8#

DM8

DQ

ZQ

DQ

ZQ

DQ

ZQ

DQ

ZQ

DQ

ZQ

DQ

ZQ

DQ

ZQ

DQ

ZQ

S1#

S0#

Rank 0: U1–U9

Rank 1: U11–U19

DM CS# DQS DQS#

BA[2:0]

A[15/14:0]

RAS#

CAS#

WE#

CKE0

CKE1

ODT0

ODT1

RESET#

BA[2:0]: DDR3 SDRAM

A[15/14:0]

: DDR3 SDRAM

RAS#: DDR3 SDRAM

CAS#: DDR3 SDRAM

WE#: DDR3 SDRAM

CKE0: Rank 0

CKE1: Rank 1

ODT0: Rank 0

ODT1: Rank 1

RESET#: DDR3 SDRAM

Rank 0

CK0

CK0#

CK1

CK1#

V

REFCA

V

SS

DDR3 SDRAM

V

DD

V

DDSPD

Temperature sensor/

SPD EEPROM

V

TT

DDR3 SDRAM

V

REFDQ

Clock, command, control, and address line terminations:

Rank 1

V

SS

V

SS

V

SS

V

SS

V

SS

V

SS

V

SS

V

SS

V

SS

ZQ

V

SS

ZQ

V

SS

ZQ

V

SS

ZQ

V

SS

ZQ

V

SS

ZQ

V

SS

ZQ

V

SS

ZQ

V

SS

ZQ

V

SS

A0

Temperature

sensor/

SPD EEPROM

A1 A2

SA0 SA1

SDA

SCL

EVT

U10

EVENT#

SA2

Command, control, and

address termination

CKE[1:0], A[15/14:0],

RAS#, CAS#, WE#,

ODT[1:0], BA[2:0],

S#[1:0]

DDR3

SDRAM

V

TT

CK

CK#

DDR3

SDRAM

V

DD

Note:

1. The ZQ ball on each DDR3 component is connected to an external 240Ω ±1% resistor

that is tied to ground. It is used for the calibration of the component’s ODT and output

driver.

4GB, 8GB (x72, ECC, DR) 240-Pin DDR3L UDIMM

Functional Block Diagram

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