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IS61NVF51236-7.5B3-TR

P1-P3P4-P6P7-P9P10-P12P13-P15P16-P18P19-P21P22-P24P25-P27P28-P30P31-P33P34-P35
4 Integrated Silicon Solution, Inc. — www.issi.com — 1-800-379-4774
Rev. E
10/25/2013
IS61NLF25672/IS61NVF25672
IS61NLF51236/IS61NVF51236
IS61NLF102418/IS61NVF102418
1 2 3 4 5 6 7 8 9 10 11
A DQg DQg A CE2 A ADV A
CE2
A DQb DQb
B DQg DQg
BWc BWg
NC
WE
A
BWb BWf
DQb DQb
C DQg DQg
BWh BWd
NC
CE
NC
BWe BWa
DQb DQb
D DQg DQg V
SS NC NC
OE
NC NC VSS DQb DQb
E DQPg DQPc V
ddq Vddq Vdd Vdd Vdd Vddq Vddq DQPf DQPb
F DQc DQc V
SS VSS VSS NC VSS VSS VSS DQf DQf
G DQc DQc V
ddq Vddq Vdd NC Vdd Vddq Vddq DQf DQf
H DQc DQc V
SS VSS VSS NC VSS VSS VSS DQf DQf
J DQc DQc V
ddq Vddq Vdd NC Vdd Vddq Vddq DQf DQf
K NC NC CLK NC V
SS
CKE
V
SS NC NC NC NC
L DQh DQh V
ddq Vddq Vdd NC Vdd Vddq Vddq DQa DQa
M DQh DQh V
SS VSS VSS NC VSS VSS VSS DQa DQa
N DQh DQh V
ddq Vddq Vdd NC Vdd Vddq Vddq DQa DQa
P DQh DQh V
SS VSS VSS ZZ VSS VSS VSS DQa DQa
R DQPd DQPh V
ddq Vddq Vdd Vdd Vdd Vddq Vddq DQPa DQPe
T DQd DQd V
SS NC NC MODE NC NC VSS DQe DQe
U DQd DQd NC A NC A NC A NC DQe DQe
V DQd DQd A A A A1 A A A DQe DQe
W DQd DQd TMS TDI A A0 A TDO TCK DQe DQe
PIN DESCRIPTIONS
Symbol PinName
A Synchronous Address Inputs
A0,A1 SynchronousAddressInputs.These
pinsmusttiedtothetwoLSBsofthe
address bus.
ADV SynchronousBurstAddressAdvance
BWa-BWh SynchronousByteWriteEnable
CE, CE2, CE2 Synchronous Chip Enable
CLK SynchronousClock
CKE Clock Enable
DQx SynchronousDataInput/Output
DQPx ParityDataI/O
VSS Ground
MODE BurstSequenceSelection
OE Output Enable
TCK,TDI JTAGPins
TDO,TMS
Vdd 3.3V/2.5VPowerSupply
Vddq
I
solatedOutputBufferSupply:
3.3V/2.5V
WE WriteEnable
ZZ Snooze Enable
PIN CONFIGURATION — 256K X 72, 209-Ball PBGA (TOP VIEW)
11x19BallBGA—14x22mm
2
Body—1mmBallPitch
Integrated Silicon Solution, Inc. — www.issi.com — 1-800-379-4774 5
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1 2 3 4 5 6 7 8 9 10 11
A NC A
CE BWc BWb CE2 CKE
ADV A A NC
B NC A CE2
BWd BWa
CLK
WE OE
A A NC
C DQPc NC V
ddq VSS VSS VSS VSS VSS Vddq NC DQPb
D DQc DQc Vddq Vdd VSS VSS VSS Vdd Vddq DQb DQb
E DQc DQc V
ddq Vdd VSS VSS VSS Vdd Vddq DQb DQb
F DQc DQc Vddq Vdd VSS VSS VSS Vdd Vddq DQb DQb
G DQc DQc V
ddq Vdd VSS VSS VSS Vdd Vddq DQb DQb
H NC VDD NC V
dd VSS VSS VSS Vdd NC NC ZZ
J DQd DQd Vddq Vdd VSS VSS VSS Vdd Vddq DQa DQa
K DQd DQd V
ddq Vdd VSS VSS VSS Vdd Vddq DQa DQa
L DQd DQd Vddq Vdd VSS VSS VSS Vdd Vddq DQa DQa
M DQd DQd V
ddq Vdd VSS VSS VSS Vdd Vddq DQa DQa
N DQPd NC V
ddq VSS NC NC NC VSS Vddq NC DQPa
P NC NC A A TdI A1* TDO A A A NC
R MODE NC A A TMS A0* TCK A A A A
Note:A0andA1arethetwoleastsignicantbits(LSB)oftheaddresseldandsettheinternalburstcounterifburstisdesired.
PIN DESCRIPTIONS
Symbol PinName
A Address Inputs
A0,A1 SynchronousBurstAddressInputs
ADV SynchronousBurstAddressAdvance/
Load
WE SynchronousRead/WriteControl
Input
CLK SynchronousClock
CKE Clock Enable
CE Synchronous Chip Select
CE2 Synchronous Chip Select
CE2 Synchronous Chip Select
BWx(x=a-d) SynchronousByteWriteInputs
Symbol PinName
OE Output Enable
ZZ Power Sleep Mode
MODE BurstSequenceSelection
TCK,TDI JTAGPins
TDO,TMS
VDD 3.3V/2.5VPowerSupply
NC NoConnect
DQx DataInputs/Outputs
DQPx ParityDataI/O
VDDQ Isolated output Power Supply
3.3V/2.5V
VSS Ground
PIN CONFIGURATION — 512K x 36, 165-Ball PBGA (TOP VIEW)
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IS61NLF51236/IS61NVF51236
IS61NLF102418/IS61NVF102418
165-PIN PBGA PACKAGE CONFIGURATION 1024K x 18 (TOP VIEW)
PIN DESCRIPTIONS
Symbol PinName
A Address Inputs
A0,A1 SynchronousBurstAddressInputs
ADV SynchronousBurstAddressAdvance/
Load
WE SynchronousRead/WriteControl
Input
CLK SynchronousClock
CKE Clock Enable
CE Synchronous Chip Select
CE2 Synchronous Chip Select
CE2 Synchronous Chip Select
BWx(x=a,b) SynchronousByteWriteInputs
OE Output Enable
ZZ Power Sleep Mode
12345678910 11
A
A
BWb
CKE
BNC
A
WE
OE
CNC
NC Vss
Vss
DNC
DQb
Vss Vss NC
ENC
DQb
Vss Vss Vss
F
NC DQb NC
GNC
DQb
NC
NC
HNC
VDD
VDDQ
J
DQb
NC
DQa
K
DQb
NC
L
DQb
NC
Vss
M DQb NC Vss
N DQPb
NC
Vss
Vss
NC
PNC
NC
A
1* TDO
R MODE
A
TCK
CE2
Vss
Vss
Vss
Vss
Vss
Vss
Vss
Vss
NC
NC
A
A
A
A
A
A
A
A
A
A
A
A
A
A
A
CE
V
DDQ
V
DDQ
V
DDQ
V
DDQ
V
DDQ
V
DDQ
V
DDQ
V
DDQ
V
DDQ
V
DDQ
NC
NC
V
DD
VDD
VDD
VDD
VDD
VDD
VDD
VDD
VDD
NC
BWa
Vss
Vss
Vss
Vss
Vss
Vss
Vss
Vss
NC
TDI
TMS
CE2
CLK
Vss
NC
A
0*
NC
Vss
Vss
Vss
Vss
Vss
Vss
ADV
V
DD
VDD
VDD
VDD
VDD
VDD
VDD
VDD
VDD
VDDQ
VDDQ
VDDQ
VDDQ
VDDQ
VDDQ
VDDQ
VDDQ
VDDQ
NC
NC
NC
DQa
DQa
DQa
NC
NC
NC
NC
NC
NC
NC
ZZ
DQa
DQa
DQa
DQa
DQPa
Note:A0andA1arethetwoleastsignicantbits(LSB)oftheaddresseldandsettheinternalburstcounterifburstisdesired.
MODE BurstSequenceSelection
TCK,TDI JTAGPins
TDO,TMS
VDD 3.3V/2.5VPowerSupply
NC NoConnect
DQx DataInputs/Outputs
DQPx ParityDataI/O
VDDQ Isolated output Power Supply
3.3V/2.5V
VSS Ground
P1-P3P4-P6P7-P9P10-P12P13-P15P16-P18P19-P21P22-P24P25-P27P28-P30P31-P33P34-P35

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IC SRAM 18M PARALLEL 165TFBGA
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