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ZL38001DGF1

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ZL38001 Data Sheet
List of Figures
7
Zarlink Semiconductor Inc.
Figure 1 - Functional Block Diagram . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 1
Figure 2 - Pin Connections . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 3
Figure 3 - ST-BUS and GCI 8-Bit Companded PCM I/O on Timeslot 0 (Mode 1) . . . . . . . . . . . . . . . . . . . . . . . . . 14
Figure 4 - ST-BUS and GCI 8-Bit Companded PCM I/O on Timeslot 2 (Mode 2) . . . . . . . . . . . . . . . . . . . . . . . . . 15
Figure 5 - ST-BUS and GCI 8-Bit Companded PCM I/O with D and C channels (Mode 3) . . . . . . . . . . . . . . . . . . 16
Figure 6 - ST-BUS and GCI 16-Bit 2’s Complement Linear PCM I/O (Mode 4). . . . . . . . . . . . . . . . . . . . . . . . . . . 17
Figure 7 - SSI Operations . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 18
Figure 8 - Serial Microport Timing for Intel Mode 0 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 22
Figure 9 - Serial Microport Timing for Motorola Mode 00 or National Microwire . . . . . . . . . . . . . . . . . . . . . . . . . . 23
Figure 10 - Master Clock - MCLK . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 26
Figure 11 - GCI Data Port Timing. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 27
Figure 12 - ST-BUS Data Port Timing . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 27
Figure 13 - SSI Data Port Timing . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 28
Figure 14 - INTEL Serial Microport Timing. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 28
Figure 15 - Motorola Serial Microport Timing. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 29
ZL38001 Data Sheet
List of Tables
8
Zarlink Semiconductor Inc.
Table 1 - Acoustic Echo Cancellation Family . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 2
Table 2 - Quiet PCM Code Assignment . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 12
Table 3 - ST-BUS & GCI Mode Select . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 17
Table 4 - SSI Enable Strobe Pins. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 18
Table 5 - Companded PCM . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 19
Table 6 - Bootload RAM Control (BRC) Register States . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 21
Table 7 - Reference Level Definition for Timing Measurements . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 26
ZL38001 Data Sheet
List of Register Tables
9
Zarlink Semiconductor Inc.
Register Table 1 - Main Control Register (MC) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 30
Register Table 2 - Acoustic Echo Canceller Control Register (AEC) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 30
Register Table 3 - Line Echo Canceller Control Register (LEC) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 31
Register Table 4 - Acoustic Echo Canceller Status Register (ASR)
(* Do not write to this register) . . . . . . . . . . . . . . . . . 32
Register Table 5 - Line Echo Canceller Status Register (LSR) (* Do not write to this register) . . . . . . . . . . . . . . . . . . . . . 33
Register Table 6 - Receive Gain Control Register . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 34
Register Table 7 - Double Talk Gain Control Register 1 (DTGCR1) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 35
Register Table 8 - Double Talk Gain Control Register 2 (DTGCR2) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 35
Register Table 9 - Double Talk detection Threshold Register (DTDT) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 36
Register Table 10 - Receive (Rin) Peak Detect Register 1 (RIPD1) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 36
Register Table 11 - Receive (Rin) Peak Detect Register 2 (RIPD2) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 37
Register Table 12 - Receive (Rin) ERROR Peak Detect Register 1 (REPD1). . . . . . . . . . . . . . . . . . . . . . . . . . . . 37
Register Table 13 - Receive (Rin) ERROR Peak Detect Register 2 (REPD2). . . . . . . . . . . . . . . . . . . . . . . . . . . . 38
Register Table 14 - Receive (Rout) Peak Detect Register 1 (ROPD1) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 38
Register Table 15 - Receive (Rout) Peak Detect Register 2 (ROPD2) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 39
Register Table 16 - Send (Sin) Peak Detect Register 1 (SIPD1) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 39
Register Table 17 - Send (Sin) Peak Detect Register 2 (SIPD2) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 40
Register Table 18 - Send ERROR Peak Detect Register 1 (SEPD1) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 40
Register Table 19 - Send ERROR Peak Detect Register 2 (SEPD2) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 41
Register Table 20 - Send (Sout) Peak Detect Register 1 (SOPD1) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 41
Register Table 21 - Send (Sout) Peak Detect Register 2 (SOPD2) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 42
Register Table 22 - Rout Limiter Register 1 (RL1). . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 42
Register Table 23 - Rout Limiter Register 2 (RL2). . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 43
Register Table 24 - Sout Limiter Register (SL). . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 43
Register Table 25 - Firmware Revision Code Register (FRC) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 44
Register Table 26 - Bootload RAM Control Register (BRC). . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 44
Register Table 27 - Bootload RAM Signature Register (SIG) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 45
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ZL38001DGF1

Mfr. #:
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Manufacturer:
Microchip / Microsemi
Description:
Communication ICs - Various Pb Free ACOUSTIC ECHO CANC.+LOW ERL COMP
Lifecycle:
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Payment:
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